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本书系统介绍了基于Quartus Ⅱ的FPGA/CPLD数字系统设计与应用，内容包括FPGA/CPLD、Quartus Ⅱ及Verilog HDL的相关知识，门电路、组合逻辑电路、时序逻辑电路的设计，常用的数字系统设计实例，可参数化宏模块及IP核的使用，以及基于Quartus Ⅱ的FPGA/CPLD系统设计实例。本书中的范例具有很强的实用性，并且均通过了软、硬件调试与仿真验证。