UVM实战

张强著

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前言
第1章与UVM的第一次接触
1.1 UVM是什么
1.2 学了UVM之后能做什么
第2章一个简单的UVM验证平台
2.1 验证平台的组成
2.2 只有driver的验证平台
2.3 为验证平台加入各个组件
2.4 UVM的终极大作：sequence
2.5 建造测试用例
第3章 UVM基础
3.1 uvm_component与uvm_object
3.2 UVM的树形结构
3.3 field automation机制
3.4 UVM中打印信息的控制
3.5 config_db机制
第4章 UVM中的TLM1.0通信
4.1 TLM1.0
4.2 UVM中各种端口的互连
4.3 UVM中的通信方式
第5章 UVM验证平台的运行
5.1 phase机制
5.2 objection机制
5.3 domain的应用
第6章 UVM中的sequence
6.1 sequence基础
6.2 sequence的仲裁机制
6.3 sequence相关宏及其实现
6.4 sequence进阶应用
6.5 virtual sequence的使用
6.6 在sequence中使用config_db
6.7 response的使用
6.8 sequence library
第7章 UVM中的寄存器模型
7.1 寄存器模型简介
7.2 简单的寄存器模型
7.3 后门访问与前门访问
7.4 复杂的寄存器模型
7.5 寄存器模型对DUT的模拟
7.6 寄存器模型中一些内建的sequence
7.7 寄存器模型的高级用法
7.8 寄存器模型的其他常用函数
第8章 UVM中的factory机制
8.1 SystemVerilog对重载的支持
8.2 使用factory机制进行重载
8.3 常用的重载
8.4 factory机制的实现
第9章 UVM中代码的可重用性
9.1 callback机制
9.2 功能的模块化：小而美
9.3 参数化的类
9.4 模块级到芯片级的代码重用
第10章 UVM高级应用
10.1 interface
10.2 layer sequence
10.3 sequence的其他问题
10.4 DUT参数的随机化
10.5 聚合参数
10.6 config_db
第11章 OVM到UVM的迁移
11.1 对等的迁移
11.2 一些过时的用法
附录A SystemVerilog使用简介
附录B DUT代码清单
附录C UVM命令行参数汇总
附录D UVM常用宏汇总

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