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Verilog HDL数字系统设计

王建民 等

《Verilog HDL数字系统设计》通过大量完整的实例介绍基于Verilog HDL进行数字系统设计的基本原理、概念和方法。全书重点关注基于HDL的寄存器传输级(Register Transfer Level ，RTL)数字系统设计，主要内容包括数字电路基础回顾、组合逻辑电路设计、规则时序逻辑电路、有限状态机以及FSMD的设计。本书所有代码兼容 Verilog HDL IEEE1364—2001标准。 尽管本书简单地回顾了数字电路的基本知识，但是如果读者能够掌握数字电路的基本原理和设计方法对于阅读本书将是十分有意义的。《Verilog HDL数字系统设计》适合高年级的本科生、研究生以及从事数字电路设计的工程人员使用。